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Ingegneria Informatica (Ακαδημαϊκό έτος 2006-2007)

Computer Architecture

Πιστώσεις: 5

Γλώσσα περιεχομένου:Ιταλικά

Περιγραφή μαθήματος

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Προϋποθέσεις

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Στόχοι

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Πρόγραμμα

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Βιβλίο

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Εργασίες

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Περιοχή Καθηγητή

Paolo Prinetto

Λίστα μαγνητοσκοπημένων παραδόσεων

• Μάθημα αρ. 1: I calcolatori elettronici: un poco di storia		Gianni Conte
• Μάθημα αρ. 2: Modelli e tecniche di descrizione		Gianni Conte
• Μάθημα αρ. 3: Il livello RTL: Struttura		Gianni Conte
• Μάθημα αρ. 4: Il livello RTL: Comportamento		Gianni Conte
• Μάθημα αρ. 5: Percorsi di dati e unita' di controllo		Gianni Conte
• Μάθημα αρ. 6: Unità di controllo microprogrammata		Gianni Conte
• Μάθημα αρ. 7: Moltiplicatore binario e architettura di base della CPU		Gianni Conte
• Μάθημα αρ. 8: Architettura RTL di una semplice CPU		Gianni Conte
• Μάθημα αρ. 9: Introduzione al linguaggio macchina		Gianni Conte
• Μάθημα αρ. 10: Modi di indirizzamento		Gianni Conte
• Μάθημα αρ. 11: Tecnologia delle memorie		Gianni Conte
• Μάθημα αρ. 12: Gerarchie di memoria e principio di località		Gianni Conte
• Μάθημα αρ. 13: Memoria Cache		Gianni Conte
• Μάθημα αρ. 14: Architettura X86		Giacomo Bucci
• Μάθημα αρ. 15: Architettura X86: accesso alla memoria		Giacomo Bucci
• Μάθημα αρ. 16: Architettura X86: repertorio istruzioni		Giacomo Bucci
• Μάθημα αρ. 17: Assembler X86: sintassi		Giacomo Bucci
• Μάθημα αρ. 18: Assembler X86: programmi		Giacomo Bucci
• Μάθημα αρ. 19: Sottosistema di ingresso/uscita: interfacce		Giacomo Bucci
• Μάθημα αρ. 20: Sottosistema di ingresso/uscita: interruzioni		Giacomo Bucci
• Μάθημα αρ. 21: Sottosistema di ingresso/uscita: interruzioni multiple		Giacomo Bucci
• Μάθημα αρ. 22: BUS di sistema		Giacomo Bucci
• Μάθημα αρ. 23: Processi RISC e superscalari : motivazioni		Giacomo Bucci
• Μάθημα αρ. 24: Processi RISC e superscalari : le pipeline		Giacomo Bucci
• Μάθημα αρ. 25: Processi RISC e superscalari : architetture superscalari		Giacomo Bucci
• Μάθημα αρ. 26: Processi RISC e superscalari : esecuzioni fuori ordine		Giacomo Bucci